news 2026/5/6 0:41:44

手把手教你用示波器实测LVDS/CML信号:从波形解读到故障排查(附实测图)

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张小明

前端开发工程师

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手把手教你用示波器实测LVDS/CML信号:从波形解读到故障排查(附实测图)

手把手教你用示波器实测LVDS/CML信号:从波形解读到故障排查(附实测图)

在高速数字电路设计中,LVDS(低电压差分信号)和CML(电流模式逻辑)是两种广泛应用的电平标准。它们凭借低功耗、高抗干扰性和出色的信号完整性特性,成为GHz级数据传输的首选方案。但对于硬件工程师来说,理论参数与实测波形之间往往存在令人困惑的差距——为什么眼图闭合?为何共模噪声超标?如何判断是阻抗失配还是端接错误?本文将用实验室实测案例,带你掌握从基础连接、参数设置到高级诊断的全套技能。

1. 测试准备:硬件连接与示波器配置

1.1 差分探头选择与校准要点

使用高压差分探头(如Keysight N2791A)时需注意:

  • 带宽选择:探头带宽应≥5倍信号基频(例如1GHz信号需5GHz探头)
  • 衰减比验证:用方波信号源检查10:1衰减是否准确
  • 共模抑制比(CMRR):≥60dB@1GHz(实测数据见下表)
探头型号带宽最大差分电压CMRR(1GHz)
N2791A1GHz±8V65dB
TDP15001.5GHz±6V70dB

提示:首次使用前必须执行DC偏置校准,将探头短路后按示波器"Auto Zero"功能

1.2 示波器关键参数设置

以12Gbps CML信号为例,推荐配置:

# 泰克MSO64基础设置 Horizontal Scale = 200ps/div Sample Rate = 40GS/s Memory Depth = 100Mpts Trigger Type = Edge (Rising) Trigger Level = 200mV

通道设置陷阱

  • 误将AC耦合用于DC耦合信号(导致VOCM测量错误)
  • 忘记启用高分辨率模式(掩盖高频噪声)
  • 阻抗误设为50Ω(应保持1MΩ匹配差分探头)

2. LVDS信号实测:从基础参数到异常诊断

2.1 标准波形特征解读

健康LVDS信号应呈现以下特征:

  • 差模电压(VOD):250-400mV(实测案例:Xilinx Artix-7输出356mV)
  • 共模电压(VOCM):1.2V±10%(实测偏差>5%需检查终端电阻)
  • 上升时间:≤300ps(20%-80%测量点)

典型异常波形对照表

波形特征可能原因解决方案
振铃明显阻抗不连续检查PCB走线阻抗突变点
共模漂移终端电阻值偏差更换1%精度100Ω电阻
眼图闭合码间干扰启用示波器均衡功能

2.2 进阶眼图分析技巧

使用SDAIII软件进行眼图参数提取:

# 伪代码示例:眼高/眼宽自动测量 eye_analysis = EyeDiagram( samples=waveform_data, UI=100ps, # 单位间隔 thresholds=[0.15, 0.85] # 交叉点阈值 ) print(f"Eye Height: {eye_analysis.height}mV") print(f"Eye Width: {eye_analysis.width}ps")

眼图优化三步骤

  1. 调整时钟恢复参数(PLL带宽设为0.01-0.1UI)
  2. 添加软件均衡(CTLE增益3-6dB)
  3. 测量抖动分量(分离RJ/DJ)

3. CML信号专项测试:应对GHz级挑战

3.1 高速信号捕获要点

针对25Gbps以上CML信号:

  • 探头焊接:使用≤3mm接地环(避免Stub效应)
  • 去嵌处理:加载S参数模型消除夹具影响
  • 触发优化:采用CDR触发模式

实测案例:100G SR4光模块CML接口

# 是德Infiniium命令 :ACQuire:MODe SEGmented :TRIGger:SOURce CLOCk :DISPlay:EYE:MASK CUSTOM,800mV,200ps

3.2 电源噪声关联分析

CML对电源纹波极度敏感(允许<20mVpp):

  1. 同步测量VCC与差分信号
  2. 使用FFT分析噪声频段
  3. 常见问题频点:
    • 100-300MHz:VRM响应不足
    • 800MHz-1GHz:封装谐振

注意:当发现周期性抖动时,优先检查电源PDN阻抗曲线

4. 故障排查实战:从现象到根因

4.1 案例一:LVDS信号过冲

现象:2.5Gbps LVDS接收端误码,波形显示过冲达120%诊断流程

  1. TDR测量显示阻抗突变(85Ω→100Ω)
  2. 扫描线长发现过孔stub 1.2mm
  3. 3D电磁仿真确认谐振点解决方案:改用背钻工艺,过孔残桩<0.3mm

4.2 案例二:CML眼图倾斜

现象:28Gbps眼图呈45°倾斜,BER恶化排查步骤

  • 确认收发端共模电压差<50mV
  • 检查AC耦合电容(100nF→22nF)
  • 最终定位:PCB叠层不对称导致延迟差优化方案:调整差分对到参考层距离误差<5%

5. 高级技巧:自动化测试与报告生成

5.1 脚本化参数测量

使用PyVISA实现自动扫描:

import pyvisa rm = pyvisa.ResourceManager() scope = rm.open_resource('TCPIP::192.168.1.100::INSTR') def measure_eye(): scope.write(":MEASure:EYE:PPAmplitude CHAN1") return float(scope.query(":MEASure:RESult?")) results = [measure_eye() for _ in range(10)] print(f"Average Eye Height: {sum(results)/len(results):.2f}mV")

5.2 测试报告关键要素

专业报告应包含:

  1. 原始波形截图(含设置参数)
  2. 眼图模板测试结果
  3. 抖动浴盆曲线
  4. 通过/失败判定依据

在最近一次PCIe Gen4验证中,这套方法帮助团队将调试周期从3周缩短到4天。关键发现是主板参考层分割导致阻抗不连续,通过调整叠层设计后眼高改善42%。

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